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用VHDL硬件描述语言实现的对FPGA(Cyclone II)的配置的VHDL源代码。...

于 2022-07-11 发布 文件大小:373.72 kB
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代码说明:

用VHDL硬件描述语言实现的对FPGA(Cyclone II)的配置的VHDL源代码。-VHDL hardware description language for FPGA (Cyclone II) configurations VHDL source code.

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    说明:  jesd204b接收部分程序和带仿真历程(Jesd204b receiving part program and simulation process)
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    2022-01-30 23:55:32下载
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  • 多功能信号发生器
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  • usbd_ucos
    说明:  基于ALINX AX7020硬件平台的USB-OTG通信程序。操作系统采用uCOS III v1.41,基本实现了双向USB2.0 块传输(Bulk Transfer)通信,zynq的PS端接收USB数据并回传至主机。经测试,主机端Window10系统采用libUSBK编程时,采用64字节的块时,传输速率可达210Mbps。zynq开发工具为Vivado2015.4,程序包中包含了全部的硬件和软件工程文档。(A USB-OTG communication project where an AX7020 platform is employed as USB device. The embeded operating system is uCOS III of version 1.41, and the FPGA toolchain is Vivado 2015.4. This project implements a full speed bidirectional USB2.0 bulk transfer. A test on Windows 10 host with libUSBK shows that the transfer speed is up to 201Mbps.)
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    thesis about design and implementation neural network using FPGA
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