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基于RAM的同步FIFO设计与实现

于 2022-09-09 发布 文件大小:9.69 kB
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代码说明:

资源描述该代码通过例化ram,然后再利用读写指针的比较来判断full和empty的状态,从而实现了同步FIFO的设计

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  • dds
    基于单片机的DDS信号发生器,具有DDS思想的单片机编程。。。(Sunplus based DDS signal generator with DDS thinking microcontrollers. . .)
    2011-09-02 15:39:02下载
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  • 基于FPGA的串口通信程序设计
    本代码是一个基于FPGA的串口通信程序设计,程序采用Verilog语言编写,工程中已经加入了仿真模型,并设置了仿真,如果你的电脑也安装了modelsim-altera,就可以直接点击RTL仿真,就能出仿真结果了。程序的主要功能实串口测试,当FPGA芯片收到上位机发送的数据时将数据再发回到上位机,在串口助手上进行显示。
    2022-03-22 10:58:18下载
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  • vga 控制器
    这是语言代码的 vga 控制器,为使用 fpga 德 70 altera 和使用 quartus, 此过程描述的水平像素计数器的操作。同步设置计数器为零 fpga_reset_n 应用时。计数器上的每个像素时钟的上升沿的递增。水平像素计数器的范围是 [0,793]。当计数器达到 793 时,它翻转为零在下一个周期。因此,该计数器有 794 像素时钟的期间。同为 25 MHz 的像素时钟,这一段时间的 31.76 μ s 转化。
    2022-07-24 06:02:42下载
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  • 128点 基8 FFT
    使用Verilog语言对128点 基8FFT的实现(Implementation of 128-point basis 8FFT)
    2018-11-29 14:39:32下载
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  • can_init
    说明:  通过SPI接口实现FPGA和MCP2515独立CAN芯片通信,功能使用modelsim仿真,实现了配置、接收、发送功能。(The communication between FPGA and MCP2515 independent can chip is realized by SPI interface. The function is simulated by Modelsim, and the function of configuration, receiving and sending is realized.)
    2020-12-30 09:28:59下载
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  • zhuangtaiji
    这是一个最最常用的用vhdl写的状态机,几乎哪儿都用得到(a very good state machine)
    2009-03-14 19:25:29下载
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  • keyscan
    用verilog语言写的简单的键盘扫描代码,适合初学者,用alter的软件编写的程序代码。(Using verilog language to write simple keyboard scan code, suitable for beginners, with alter software program written code.)
    2013-09-13 22:59:11下载
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  • ram_2
    简易双口ram,使用两个ram ip core,一个写的同时另一个读,并且包含按键使能和数码管以及流水灯显示(Simple dual-port ram, two ram the ip core, a write while another read, and contains buttons to enable digital pipe and the water light show)
    2012-07-08 13:05:27下载
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  • clock18div
    Clock Divider, divfactor of 18
    2015-03-24 18:04:49下载
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  • ddr3 sdram 控制器代码,verilog
    根据DDR3的特点和操作原理,利用MIG软件工具在Virtex-6系列FPGA中实现DDR3SDRAM控制器的设计,并给出了硬件测试的结果,代码为verilog,通过仲裁机制完成设计,希望对学习fpga的人有帮助
    2022-07-09 17:26:37下载
    积分:1
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